题目内容（请给出正确答案）

[单选题]

时序逻辑电路的输出（)有关。

A.只与当前的输入

B.只与原先的状态

C.与当前的输入和原来的状态

D.与电源电压

答案

C、与当前的输入和原来的状态

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第1题

Mealy型时序逻辑电路的输出与电路的现态和电路的输入有关。（)

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第2题

时序逻辑电路在某一时刻的输出状态与该时刻之前的输入信号无关。（)

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第3题

下列特点中不属于非时序逻辑系统特点的是（)。

A.输入变量的取值是随机的

B.输入无先后顺序

C.系统输出只与输入变量的组合有关

D.系统输出与变量取值的先后顺序有关

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第4题

时序逻辑电路的电路状态是指（)。

A.外部输入

B.内部输出

C.触发器的输出

D.外部输出

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第5题

关于以下程序，下列说法正确的是（)。moduleLearn5_2（a,b,c,d,e);inputa,b,c,d;outpute;rege;always@（aorborcord)case（{a,b})2`b11:e=d;2`b10:e=~c;default:e=1’bx;endcaseendmodule

A.该程序为时序逻辑电路

B.该程序中存在不完整条件语句

C.当输入为a=0;b=0时，输出e=1’bx

D.该程序不会生成锁存器

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第6题

时序逻辑电路的数码寄存器结果与输入不同，是（)有问题。A.清零端B.送数端C.脉冲端D.输出端

时序逻辑电路的数码寄存器结果与输入不同，是()有问题。

A.清零端

B.送数端

C.脉冲端

D.输出端

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第7题

在以下程序中，Clk_50M为频率为50MHz的系统时钟，则下列说法中正确的有()。regClk;reg[31:0]Cnt;always@(posedgeClk_50MornegedgeRst)beginif(!Rst)beginCnt＜=1;Clk＜=1;endelsebeginif(Cnt＞=25000000)beginCnt＜=1;Clk＜=~Clk;endelseCnt＜=Cnt+1;endend

A.该模块为同步复位

B.该模块的功能是分频器

C.若系统时钟频率为50MHz，则输出Clk的频率为2MHz

D.该程序为时序逻辑电路

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第8题

在任何时刻，输出状态只决定于同一时刻各输入状态的组合，而与先前状态无关的逻辑电路称为组合逻辑电路。（)

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第9题

时序电路通常具有记忆功能，组合逻辑电路某时刻的输出只决定于该时刻的输入。（)

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第10题