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[主观题]

设计一个代码转换电路,输人为4位二进制代码,输出为4位格雷码.可以采用各种逻辑功能的门电路来实现.4位格雷码见《数字电子技术基础》(第五版)中第1.5节的表1.5.2.

设计一个代码转换电路,输人为4位二进制代码,输出为4位格雷码.可以采用各种逻辑功能的门电路来实现.4位格雷码见《数字电子技术基础》（第五版)中第1.5节的表1.5.2.

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第1题

试用一片4位数值比较器74LS85和一片4位二进制加法器74LS283设计一个4位二进制数到8421 BCD码的转换电路。

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第2题

设计一个代码转换电路,将余3码转換成8421BCD代码.具体设计要求如下:(1)全用门电路来实现最简的逻辑电路;(2)用74283附加必要的门电路来实现,西出逻辑电路图.

设计一个代码转换电路,将余3码转換成8421BCD代码.具体设计要求如下:（1)全用门电路来实现最简的逻辑电路;（2)用74283附加必要的门电路来实现,西出逻辑电路图.

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第3题

用四位二进制并行加法器实现8421码转换成余3码的代码转换电路，是将输入8421码加上（）。

A.1100

B.0011

C.0001

D.0010

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第4题

某控制系统要求在CP的作用下产生时序信号v_a、v_b。两信号与CP的时序关系如图题9.1.6所示。

用4位二进制计数器74LVC161、集成单稳74121设计该信号产生电路，试画出无识别结果电路图。

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第5题

试用 Verilog语言描述一个4位二进制可逆计数器的行为。要求如下：（1)电路具有5种功能，即异步清零

试用 Verilog语言描述一个4位二进制可逆计数器的行为。要求如下：

(1)电路具有5种功能，即异步清零、同步置数、递增计数、递减计数和保持原有状态不变。且要求计数器能输出进位信号和借位信号，即当计数器递增计数到最大值时，产生一个高平有效的进位信号C₀;当计数器递减计数到最小值0时，产生一个高电平有效的借位信号B₀。

(2)用QuartusI软件进行逻辑功能仿真，并给出仿真波形。

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第6题

集成施密特触发器和4位同步二进制加法器74LVC161组成的电路如图题9.2.4所示。(1)分别说明图中两

集成施密特触发器和4位同步二进制加法器74LVC161组成的电路如图题9.2.4所示。（1)分别说明图中两

集成施密特触发器和4位同步二进制加法器74LVC161组成的电路如图题9.2.4所示。

(1)分别说明图中两部分电路的功能;

(2)画出图中74LVC161组成的电路的状态图;

(3)画出图中v_a、v_b和v₀的对应波形。

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第7题

试用译码器74HC138和必要的与非门，设计一个乘法器电路，实现两位二进制数相乘，并输出结果。

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第8题

用ISP技术设计一个4位二进制计数器CBU14,写出VHDL源文件.

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第9题

将输入二进制代码译成相应输出信号的电路，成为二进制译码器。（)

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第10题

现有一片74LS299八位通用移位寄存器,一片8位74LS373锁存器,另有一个D触发器和一个非门.设计8位数据的串行并行的一次转换电路.用CLK脉冲进行控制.

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